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時鐘發(fā)生器芯片廠家

描述:時鐘發(fā)生器芯片廠家 時鐘芯片是一種基于PLL的時鐘發(fā)生器,采用ADPLL(全數(shù)字鎖相環(huán))技術(shù),以實現(xiàn)的高頻低相噪性能,并具備低功耗和高PSNR能力,可實現(xiàn)小于0.3ps RMS的相位抖動性能。

  • 產(chǎn)品型號:賽思
  • 廠商性質(zhì):生產(chǎn)廠家
  • 更新時間:2024-10-10
  • 訪問量:786
產(chǎn)品詳情/ PRODUCT DETAIL

標題:時鐘發(fā)生器芯片廠家

產(chǎn)品概述

時鐘發(fā)生器芯片廠家 時鐘芯片一種基于PLL的時鐘發(fā)生器,采用ADPLL全數(shù)字鎖相環(huán)技術(shù),以實現(xiàn)的高頻低相噪性能,并具備低功耗和高PSNR能力可實現(xiàn)小于0.3ps RMS的相位抖動性能。

時鐘發(fā)生器芯片廠家輸出差分100MHz,125MHz,156.25MHz和單端33.33MHz CPU時鐘,同時輸出625MHz緩沖參考時鐘。

? 主要特性

l 7路單端LVCMOS輸出,輸出阻抗為30Ω;

l 3LVPECL輸出

-- 1路差分LVPECL輸出對(QAnQA)的輸出頻率為156.25 MHz

-- 2路可選的差分LVPECL輸出對(QB,nQBQC,nQC)的輸出頻率為100 MHz125 MHz

l 1路單端LVCMOS輸出(QD)的頻率為33.33MHz CPU時鐘

l 可選外部晶體或單端輸入源

l 晶體振蕩器接口用于25MHz晶體

l DCO頻率:2.5GHz

l 125MHz下的RMS相位抖動,使用25MHz晶體(12kHz~20MHz):0.188ps(典型

l 電源噪聲抑制PSNR-70dB

l +3.3 V電源電壓

l -40°C85°C環(huán)境工作溫度

l 無鉛(RoHS 6)封

l 40引腳VFQFN封裝6.0 × 6.0 × 0.85mm

? 時鐘芯片應(yīng)用場景

l 無線基站

l 以太網(wǎng)線卡,交換機和路由器

l SCSISATA,and PCI-express

l 低抖動,低相噪時鐘發(fā)生器



賽思是一家為萬物互聯(lián)同頻的時頻科技企業(yè),基于業(yè)界的時頻科研與方案能力,賽思打造出軟硬一體化的時頻產(chǎn)品體系,面向電力、交通、通信、智能樓宇、數(shù)據(jù)中心、前沿領(lǐng)域等核心場景提供解決方案,持續(xù)為客戶和社會創(chuàng)造價值。

浙江賽思電子科技有限公司成立于2013年,注冊資金2.15億人民幣,總部位于浙江嘉興科技城,全球研創(chuàng)總部位于北京中關(guān)村科幻產(chǎn)業(yè)創(chuàng)新中心,另設(shè)有西安、成都、武漢、深圳研發(fā)分部??偛空嫉孛娣e20多畝,擁有近2萬平的研發(fā)辦公場所。

浙江賽思電子科技有限公司是工信部國家新興產(chǎn)業(yè)創(chuàng)業(yè)投資引導基金、北京集成電路芯片基金、中國聯(lián)通等國資背景基金重點投資的、科技部重點扶持的、多個省市政府重點投資引進的pre-IPO硬科技企業(yè)、國家、專精特新“小巨人"企業(yè)。

公司核心團隊出自全球頂尖時鐘技術(shù)公司,擁有國內(nèi)時頻行業(yè)技術(shù);

自有FPGA守時和授時算法,可提升時鐘守時和授時能力;

自研TDC技術(shù),可提升PTP打戳精度;

采用kalman濾波算法和智能參數(shù)匹配和PI控制,可實現(xiàn)高精度馴服控制;

具有硬件設(shè)計與軟件深度定制開發(fā)能力,可提供定制化解決方案;

所有時頻關(guān)鍵技術(shù)都有自研能力,無需外協(xié)功能模塊,可快速定位和解決產(chǎn)品問題;

具有時頻大型組網(wǎng)和管理能力,可以為社會各行各業(yè)的系統(tǒng)精準運行做到保障傳輸、降低延時與通信加密的護航作用。


時鐘發(fā)生器芯片廠家




 
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